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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>網(wǎng)絡(luò)協(xié)議論文>基于FPGA的DDR3協(xié)議解析邏輯設(shè)計

      基于FPGA的DDR3協(xié)議解析邏輯設(shè)計

      2017-12-05 | rar | 1.11 MB | 次下載 | 3積分

      資料介紹

      　　針對采用DDR3接口來設(shè)計的新一代閃存固態(tài)盤（SSD）需要完成與內(nèi)存控制器進(jìn)行通信與交互的特點，提出了基于現(xiàn)場可編程門陣列（ FPGA）的DDR3協(xié)議解析邏輯方案。首先，介紹了DDR3內(nèi)存工作原理，理解內(nèi)存控制器對存儲設(shè)備的控制機(jī)制；然后，設(shè)計了接口協(xié)議解析邏輯的總體架構(gòu)，采用FPGA實現(xiàn)并對其中的各個關(guān)鍵技術(shù)點，包括時鐘、寫平衡、延遲控制、接口同步控制等進(jìn)行詳細(xì)闡述；最后，通過modelsim仿真并進(jìn)行板級驗證，證明了該設(shè)計的正確性和可行性。在性能方面，通過單次讀寫、連續(xù)讀寫和混合讀寫三種模式下的數(shù)據(jù)讀寫測試，取得了最高77. 81%的DDR3接口帶寬利用率，在實際的SSD開發(fā)過程中能夠有效提高系統(tǒng)的訪問性能。

      基于FPGA的DDR3協(xié)議解析邏輯設(shè)計

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