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      電子發(fā)燒友網(wǎng)>電子資料下載>視頻教程下載>vivado Final_IP+Integrator視頻演示

      vivado Final_IP+Integrator視頻演示

      2012-04-25 | zip | 5 MB | 次下載 | 免費(fèi)

      資料介紹

      為了解決實(shí)現(xiàn)的瓶頸，Vivado 工具采用層次化器件編輯器和布局規(guī)劃器、速度提升 了3 至 15 倍且為 SystemVerilog 提供業(yè)界領(lǐng)先支持的邏輯綜合工具、速度提升 了4 倍且確定性更高的布局布線引擎、以及通過分析技術(shù)可最小化時(shí)序、線長(zhǎng)、路由擁堵等多個(gè)變量的“成本”函數(shù)。此外，增量式流程能讓工程變更通知單 (ECO) 的任何修改只需對(duì)設(shè)計(jì)的一小部分進(jìn)行重新實(shí)現(xiàn)就能快速處理，同時(shí)確保性能不受影響。

      賽靈思vivado設(shè)計(jì)套件專題:http://wenjunhu.com/topic/tech/vivado/


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