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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>HFAN-04.5.5評(píng)估電源噪聲抑制比對(duì)PLL時(shí)鐘合成器的

      HFAN-04.5.5評(píng)估電源噪聲抑制比對(duì)PLL時(shí)鐘合成器的

      2009-06-19 | rar | 322 | 次下載 | 5積分

      資料介紹

      HFAN-04.5.5評(píng)估電源噪聲抑制比對(duì)PLL時(shí)鐘合成器的影響

      Characterizing Power-Supply Noise Rejection in PLL Clock Synthesizers

      This application note discusses the effects of powersupply
      noise interference on PLL-based clock
      generators. It describes several measurement
      techniques for evaluating the resulting DJ
      (deterministic jitter). Relationships are derived
      outlining how frequency-domain spur measurements
      can be used to evaluate timing jitter behavior.
      Laboratory bench-test results are used to compare
      the approaches, and demonstrate how to reliably
      assess the PSNR (power-supply noise rejection)
      performance of a reference clock generator

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