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鎖相環(huán)(PLL)是電信應(yīng)用中使用的主要部件。本應(yīng)用報(bào)告討論如何利用DAC348x系列的片內(nèi)PLL從低頻參考時(shí)鐘產(chǎn)生高頻數(shù)模轉(zhuǎn)換器(DAC)采樣時(shí)鐘。PLL將DAC 348 x用作倍頻器，簡化了與更高頻率DAC采樣時(shí)鐘相關(guān)的系統(tǒng)和板級(jí)設(shè)計(jì)。系統(tǒng)設(shè)計(jì)人員可以適應(yīng)現(xiàn)代通信應(yīng)用所需的更高數(shù)據(jù)速度，同時(shí)降低高速時(shí)鐘發(fā)生器或頻率合成器的成本和設(shè)計(jì)要求。然而，一個(gè)不利因素是，與其它高性能時(shí)鐘解決方案相比，片內(nèi)PLL可能存在抖動(dòng)和雜散性能限制。為了幫助設(shè)計(jì)人員進(jìn)行DAC348x的片內(nèi)PLL配置和優(yōu)化，本報(bào)告討論了通過調(diào)整分頻器比率和PFD頻率等PLL參數(shù)來減輕相位噪聲性能下降和鑒頻鑒相器(PFD或PD)雜散的方法。本應(yīng)用筆記還展示了如何將一些常見通信信號(hào)中的相位噪聲和PFD雜散影響降至最低
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