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摘要：為了克服用于芯片上電源地（P/R）網(wǎng)絡(luò)分析的一般隨機行走算法在求解整個網(wǎng)絡(luò)時效率比較低下、求解時間與理想電壓源節(jié)點（VDD）所占比例成反比變化，以及求解WIRE-BOND類型的P/R網(wǎng)絡(luò)時運算時間與網(wǎng)絡(luò)規(guī)模呈超線性復(fù)雜度等缺點，提出了一種改進(jìn)的隨機行走算法。該算法充分利用一次行走所獲得的信息，將節(jié)點的一次行走分解為所經(jīng)過節(jié)點的若干次隨機行走，每到達(dá)一個未知電壓值節(jié)點等效為該節(jié)點一次隨機行走的開始，仿真結(jié)果表明，在可以忽略的誤差范圍內(nèi)，改進(jìn)后算法的求解速度比一般隨機行走算法求解速度要快十多倍，求解時間不隨VDD所占比例而變化，且對于WIRE-BOND類型的P/R網(wǎng)絡(luò)具有線性時間復(fù)雜度。
關(guān)鍵詞：電源/地網(wǎng)絡(luò)；改進(jìn)的隨機行走算法；線性時間復(fù)雜度
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