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基于對脈沖信號的多路延遲轉(zhuǎn)發(fā)的需求，本文介紹了一種基于軟件無線電思想設計的全數(shù)字脈沖信號延遲轉(zhuǎn)發(fā)系統(tǒng)。描述了系統(tǒng)架構(gòu)，給出了以FPCJA為核心處理器的系統(tǒng)框圖，同時描述了信號處理流程及邏輯設計，其中包括數(shù)字上、下變頻中的并行DDS和多相濾波，以及延遲模塊的實現(xiàn)。完成了基于FPGA及高速A/D、D/A的系統(tǒng)實現(xiàn)，在Xilinx的Vivado開發(fā)環(huán)境下完成了邏輯設計。實測表明該系統(tǒng)能夠正確產(chǎn)生多路延遲后的脈沖信號，具有系統(tǒng)結(jié)構(gòu)簡潔、參數(shù)設置靈活以及功能改進潛力大等優(yōu)點。
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