資料介紹
隨著集成電路工藝的飛速發(fā)展,高速化和小型化已經(jīng)成為電路設(shè)計(jì)的一種趨勢(shì)。高速PCB設(shè)計(jì)的密度、復(fù)雜度越來越高,信號(hào)完整性成為了現(xiàn)代高速電路設(shè)計(jì)中必須要考慮的因素,其設(shè)計(jì)成敗直接關(guān)系到系統(tǒng)功能的實(shí)現(xiàn)。PCB設(shè)計(jì)中最主要的信號(hào)完整性問題是反射和串?dāng)_,文中主要研究了工型拓?fù)渲蟹瓷鋵?duì)信號(hào)的影響,通過仿真得到一些減弱電路中反射對(duì)信號(hào)影響的方法。
反射是高速電路信號(hào)完整性的一個(gè)重要內(nèi)容,在高速電路設(shè)計(jì)中是不可忽視的。研究工型拓?fù)涞姆瓷溆?jì)算方法,并借助MentorC;raphics公司的信號(hào)完整性分析工具HyperLynx仿真軟件,對(duì)信號(hào)反射的多種因素進(jìn)行分析。最后根據(jù)仿真結(jié)果,提出了減小反射的有效措施。
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