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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>IC/FPGA低功耗設(shè)計(jì)

      IC/FPGA低功耗設(shè)計(jì)

      2021-11-06 | pdf | 221.75KB | 次下載 | 2積分

      資料介紹

      1.概念功耗的構(gòu)成：三個(gè)主要的功耗源：浪涌、靜態(tài)功耗和動(dòng)態(tài)功耗；浪涌電流： 指器件上電時(shí)產(chǎn)生的最大瞬時(shí)輸入電流，稱為啟動(dòng)電流；浪涌電流與設(shè)備相關(guān)； 浪涌功耗不是我們需要關(guān)注的地方，因此這里只是說明有這個(gè)功耗存在。靜態(tài)功耗：也稱待機(jī)功耗，靜態(tài)功耗主要由晶體管的漏電流所導(dǎo)致的功耗；動(dòng)態(tài)功耗：包括開關(guān)功耗或者稱為翻轉(zhuǎn)功耗、短路功耗或者稱為內(nèi)部功耗。動(dòng)態(tài)功耗影響因素：門寄生電容、時(shí)鐘翻轉(zhuǎn)率、時(shí)鐘頻率、供電電壓；降低功耗：應(yīng)當(dāng)在所有設(shè)計(jì)層次上進(jìn)行，即系統(tǒng)級(jí)、邏輯級(jí)和物理級(jí)，層次越高對(duì)功耗降低越
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