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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA時(shí)序邏輯和組合邏輯的入門基礎(chǔ)教程

      FPGA時(shí)序邏輯和組合邏輯的入門基礎(chǔ)教程

      2020-12-09 | rar | 1.65 MB | 次下載 | 免費(fèi)

      資料介紹

      　　組合邏輯：

      　　組合邏輯電路是指在任何時(shí)刻，輸出狀態(tài)只決定于同一時(shí)刻各組合邏輯電路輸入狀態(tài)的組合，而與電路以前狀態(tài)無關(guān)而與其他時(shí)間的狀態(tài)無關(guān)。如：加法器、編碼器、譯碼器、選擇器等

      　　存儲(chǔ)電路：

      　　雙穩(wěn)態(tài)電路的特點(diǎn)是：在沒有外來觸發(fā)信號(hào)的作用下，電路始終處于原來的穩(wěn)定狀態(tài)。在外加輸入觸發(fā)信號(hào)作用下，雙穩(wěn)態(tài)電路從一個(gè)穩(wěn)定狀態(tài)翻轉(zhuǎn)到另一個(gè)穩(wěn)定狀態(tài)。由于它具有兩個(gè)穩(wěn)定狀態(tài)，故稱為 雙穩(wěn)態(tài)電路。

      　　時(shí)序邏輯電路：

      　　（1 ）時(shí)序邏輯電路由組合電路和存儲(chǔ)電路組成

      　?。? ）時(shí)序邏輯的狀態(tài)和時(shí)間因素相關(guān)，即時(shí)序電路在任一時(shí)刻的狀態(tài)變量不僅是當(dāng)前輸入信號(hào)的函數(shù)，而且還是電路以前狀態(tài)的函數(shù)，時(shí)序電路的輸出信號(hào)由輸入信號(hào)和電路的狀態(tài)共同決定。

      　　（3 ）時(shí)序電路是狀態(tài)依賴的，故又稱狀態(tài)機(jī)。

      　　時(shí)序邏輯電路：同步時(shí)序電路和異步時(shí)序電路。

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