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      電子發(fā)燒友網(wǎng)>電子資料下載>IC datasheet pdf>SN74F175,pdf(Quadruple D-Type

      SN74F175,pdf(Quadruple D-Type

      2010-07-29 | rar | 481 | 次下載 | 3積分

      資料介紹

      This positive-edge-triggered flip-flop utilizes TTL circuitry to implement D-type flip-flop logic with a direct clear (CLR)\ input. Information at the data (D) inputs meeting setup-time requirements is transferred to outputs on the positive-going edge of the clock pulse. Clock triggering occurs at a particular voltage level and is not directly related to the transition time of the positive-going pulse. When the clock (CLK) input is at either the high or low level, the D-input signal has no effect at the output.
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