實現(xiàn)補碼加減運算的邏輯電路

實現(xiàn)補碼加減運算的邏輯電路

運算前，X、Y寄存器分別存儲被加（減）數(shù) 和加（減）數(shù)，計算結(jié)果存回X寄存器；F為加法器，能在命令X→F和Y→F信號的控制下接收兩個寄存器中的數(shù)據(jù)并完成加法運算，運算結(jié)果在F→X命令信號的控制下接收回X寄存器中。

　　為實現(xiàn)減運算，應(yīng)將Y寄存器中補碼數(shù)據(jù)的負數(shù)表示送到加法器F，這可以通過送Y寄存器中每位數(shù)據(jù)的反碼并在F的最低位給出進位1輸入信號變通完成，用/Y→F和1→F控制命令實現(xiàn)。

圖2.5 實現(xiàn)補碼加減運算的邏輯電路

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補碼(7470) 補碼(7470)

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