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• 在低功耗MCU上實(shí)現(xiàn)人工智能和機(jī)器學(xué)習(xí)

  TinyML對于直接在設(shè)備上實(shí)現(xiàn)智能決策、促進(jìn)實(shí)時處理和減少延遲至關(guān)重要，特別是在連接有限或無連接的環(huán)境中。...

  192次閱讀 · 0評論 mcu人工智能機(jī)器學(xué)習(xí)

• 萊迪思分析不斷變化的網(wǎng)絡(luò)安全形勢下FPGA何去何從

  萊迪思安全專家與Secure-IC的合作伙伴一起討論了不斷變化的網(wǎng)絡(luò)安全環(huán)境以及現(xiàn)場可編程門陣列（FPGA）技術(shù)在構(gòu)建網(wǎng)絡(luò)彈性中的作用。...

  1052次閱讀 · 0評論 FPGA萊迪思網(wǎng)絡(luò)安全Lattice

• FPGA是實(shí)現(xiàn)敏捷、安全的工業(yè)4.0發(fā)展的關(guān)鍵

  到2028年，全球工業(yè)4.0市場規(guī)模預(yù)計將超過2790億美元，復(fù)合年增長率為16.3%。雖然開發(fā)商和制造商對這種高速增長已經(jīng)習(xí)以為常，但其影響才剛剛開始顯現(xiàn)。通過結(jié)合云計算、物聯(lián)網(wǎng)（IoT）和人工智能（AI）的能力，工業(yè)4.0將在未來幾年繼續(xù)提升制造業(yè)的數(shù)字化、自動化和互連計算水平，推動更多企業(yè)擁抱...

  866次閱讀 · 0評論 FPGA萊迪思工業(yè)4.0

• FPGA入門必備：Testbench仿真文件編寫實(shí)例詳解

  在編寫完HDL代碼后，往往需要通過仿真軟件Modelsim或者Vivadao自帶的仿真功能對HDL代碼功能進(jìn)行驗證，此時我們需要編寫Testbench文件對HDL功能進(jìn)行測試驗證。...

  2507次閱讀 · 0評論 FPGAHDLDUT

• 基于FPGA的FIR數(shù)字濾波器設(shè)計方案

  FPGA元器件在高速并行處理和數(shù)據(jù)傳輸中有獨(dú)特優(yōu)勢，F(xiàn)PGA正在前端信號處理中越來越多地代替ASIC和DSP。我們需要的就是這種設(shè)計周期短，功能密度高，重組時間短的元器件。...

  4287次閱讀 · 0評論 dspFPGAasic數(shù)字濾波器信號處理
  

• Xilinx FPGA的約束設(shè)置基礎(chǔ)

  LOC約束是FPGA設(shè)計中最基本的布局約束和綜合約束，能夠定義基本設(shè)計單元在FPGA芯片中的位置，可實(shí)現(xiàn)絕對定位、范圍定位以及區(qū)域定位。...

  1554次閱讀 · 0評論 FPGAXilinx字符串
  

• 基于Verilog HDL的FPGA圖像濾波處理仿真實(shí)現(xiàn)

  注意這里的A是double類型的，直接進(jìn)行imshow會全白，要轉(zhuǎn)化到0-1：A=A./255，或者把double類型轉(zhuǎn)化為整形。...

  694次閱讀 · 0評論 FPGAVerilog圖像濾波
  

• Zynq-7000為何不是FPGA？

  Zynq-7000可擴(kuò)展處理平臺是采用賽靈思新一代FPGA（Artix-7與Kintex-7FPGA）所采用的同一28nm可編程技術(shù)的最新產(chǎn)品系列。...

  1516次閱讀 · 0評論 處理器FPGA可編程邏輯嵌入式處理器Zynq
  

• 基于FPGA的內(nèi)部LVDS接收器設(shè)計

  LVDS是一種低壓低功耗的高速串行差分?jǐn)?shù)據(jù)傳輸標(biāo)準(zhǔn)，在高速數(shù)據(jù)互聯(lián)和數(shù)據(jù)通信領(lǐng)域得到廣泛的應(yīng)用，主流的FPGA器件都集成了高速的LVDS收發(fā)器。...

  2064次閱讀 · 1評論 FPGA模擬電路adclvds模數(shù)轉(zhuǎn)換器
  

• FPGA的時鐘電路結(jié)構(gòu)原理

  FPGA 中包含一些全局時鐘資源。以AMD公司近年的主流FPGA為例，這些時鐘資源由CMT（時鐘管理器）產(chǎn)生，包括DCM、PLL和MMCM等。...

  2246次閱讀 · 0評論 FPGA鎖相環(huán)pll時鐘管理器時鐘信號
  

• AMD FPGA中MicroBlaze的固化流程詳解

  AMD FPGA在配置了適當(dāng)?shù)膯幽Ｊ胶?，上電即會按該模式去加載配置文件。以7系列FPGA為例，假設(shè)設(shè)置模式引腳M[2:0]=3’b001，上電后FPGA會以Master SPI方式嘗試從FLASH加載配置文件，其與工程是否含有MicroBlaze IP無關(guān)。...

  750次閱讀 · 0評論 FPGAamduart嵌入式處理器GPIO
  

• 基于FPGA設(shè)計的BRAM內(nèi)部結(jié)構(gòu)

  再看末級觸發(fā)器對BRAM時序性能的影響，下圖依次展示了7系列FPGA、UltraScale+和Versal芯片在未使用和使用末級觸發(fā)器兩種情形下時鐘到輸出的延遲。...

  534次閱讀 · 0評論 FPGA鎖存器觸發(fā)器BRAM
  

• 基于FPGA技術(shù)的USB2.0接口設(shè)計實(shí)踐

  本次設(shè)計我們選擇一款開發(fā)設(shè)備，一塊廉價的開發(fā)板，其中的USB芯片是Cypress的FX2LP系列中的CY7C68013A代，詳細(xì)的介紹大家可以去Cypress的官網(wǎng)查詢。下面簡述一下設(shè)計思路。...

  1576次閱讀 · 0評論 FPGA單片機(jī)usb上位機(jī)type-c
  

• FPGA技術(shù)的五大優(yōu)勢

  各行各業(yè)紛紛采用FPGA芯片是源于FPGA融合了ASIC和基于處理器的系統(tǒng)的最大優(yōu)勢。 FPGA能夠提供硬件定時的速度和穩(wěn)定性，且無需類似自定制ASIC設(shè)計的巨額前期費(fèi)用的大規(guī)模投入。...

  1399次閱讀 · 0評論 FPGA集成電路asic信號處理器

• 基于FPGA VHDL的ASK調(diào)制與解調(diào)

  ASK即“幅移鍵控”又稱為“振幅鍵控”，也有稱為“開關(guān)鍵控”（通斷鍵控）的，所以又記作OOK信號。ASK是一種相對簡單的調(diào)制方式。...

  730次閱讀 · 0評論 FPGA模擬信號vhdlASK調(diào)制信號
  

• 基于FPGA的數(shù)字電壓表（AD）設(shè)計

  TLC549是一個8位的串行模數(shù)轉(zhuǎn)換器，A/D轉(zhuǎn)換時間最大為17us，最大轉(zhuǎn)換速率為4MHz。下圖為TLC549的訪問時序，從圖中可以看出，TLC549的使用只需對外接輸入輸出時鐘（I/O CLK）和芯片選擇（/CS）、輸入的模擬信號（ANALOG IN）的控制。...

  1553次閱讀 · 0評論 FPGA轉(zhuǎn)換器電壓表模數(shù)轉(zhuǎn)換器模擬信號
  

• Xilinx 7系列FPGA功能特性介紹

  Xilinx7系列FPGA由四個FPGA系列組成，可滿足一系列系統(tǒng)需求，從低成本、小尺寸、成本敏感的大容量應(yīng)用到最苛刻的高性能應(yīng)用的超高端連接帶寬、邏輯容量和信號處理能力。...

  6620次閱讀 · 0評論 微控制器FPGA收發(fā)器Xilinx信號處理
  

• 基于FPGA技術(shù)的手勢識別控制型多功能機(jī)械臂系統(tǒng)

  首先通過圖像采集設(shè)備來獲取手勢圖像，通過手勢建模將獲取的手勢圖像用數(shù)學(xué)模型描述出來，最后根據(jù)得到的手勢識別所需要的模型參量判別出具體的手勢形態(tài)。...

  1545次閱讀 · 0評論 FPGA手勢識別機(jī)器視覺機(jī)械臂

• 基于FPGA技術(shù)的智能駕駛輔助系統(tǒng)設(shè)計方案

  圖像的采集使用的是 NUOXI ZL-008 型號USB 攝像頭，該攝像頭支持分辨率640*480，幀率 30 幀/秒，增強(qiáng)像素數(shù)1200 萬，可以滿足本文研究中對 圖像的清晰度和實(shí)時性的要求。...

  657次閱讀 · 0評論 FPGA示波器soc匯編器
  

• Xilinx FPGA BGA設(shè)計：NSMD和SMD焊盤的區(qū)別

  Xilinx建議使用非阻焊定義的（NSMD）銅材BGA焊盤，以實(shí)現(xiàn)最佳板設(shè)計。NSMD焊盤是不被任何焊料掩模覆蓋的焊盤，而阻焊定義的（SMD）焊盤中有少量阻焊層蓋住焊盤平臺。...

  3826次閱讀 · 0評論 FPGASMDXilinxBGA焊盤
  
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