verilog

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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog資訊

H.264/AVC中量化的Verilog方法介紹及實(shí)現(xiàn)

H.264/AVC中量化的Verilog方法介紹及實(shí)現(xiàn) 0 引言　　H.264作為新一代的視頻壓縮標(biāo)準(zhǔn)，是由ITU-T...

2009-11-12 標(biāo)簽：Verilog 1132 0

20GB英特爾芯片機(jī)密數(shù)據(jù)被黑客竊取并分享！

這些曝光的數(shù)據(jù)稱之為“Intel exconfidential Lake”，黑客聲稱這些數(shù)據(jù)沒有在任何地方公布過，而且大部分信息都處于嚴(yán)格的保密協(xié)議（N...

2022-10-20 標(biāo)簽：英特爾 Verilog 源代碼 1088 0

處理以太網(wǎng)幀以及IP，UDP和ARP的模塊

頂層千兆和10G MAC模塊是eth_mac_ *，具有各種接口，并且?guī)в?不帶有FIFO。頂層10G PCS/PMA PHY模塊為eth_phy_10...

2022-06-30 標(biāo)簽：以太網(wǎng)Verilog 數(shù)據(jù)包 1086 0

博客園正式支持Verilog語法著色功能

以前在貼Verilog代碼時(shí)，都只能挑C++或者C#的語法著色，但兩者的主題詞畢竟不太一樣，透過dudu的幫助，我將Verilog 2001年的主題詞加...

2011-05-10 標(biāo)簽：Verilog 博客園 1080 0

針對(duì)C語言編程者的Verilog開發(fā)指南實(shí)例

針對(duì)C語言編程者的Verilog開發(fā)指南實(shí)例本文舉例說明了如何用軟件實(shí)現(xiàn)脈寬調(diào)制(PWM)，如何將該設(shè)計(jì)轉(zhuǎn)換成一個(gè)可以在FPGA中運(yùn)行的邏輯塊，并能利用

2009-12-27 標(biāo)簽：Verilog 1026 0

基于Verilog-HDL的軸承振動(dòng)噪聲電壓峰值檢測

摘要：介紹模擬峰值電壓的檢測方式，敘述基于Verilog-HDL與高速A/D轉(zhuǎn)換器相結(jié)合所實(shí)現(xiàn)的數(shù)字式快速軸承噪聲檢測方法，給出相關(guān)的Verilog-H...

2009-06-20 標(biāo)簽：Verilog 997 0

為了方便仿真這樣寫個(gè)ROM

系統(tǒng)函數(shù)$readmemh和$readmemb分別用來讀取十六進(jìn)制文件和二進(jìn)制文件。貌似沒有讀十進(jìn)制的。txt中的數(shù)據(jù)每行一個(gè)不需要逗號(hào)和最后一個(gè)數(shù)據(jù)后...

2022-12-21 標(biāo)簽：asic ROM Verilog 988 0

Verilog基礎(chǔ)知識(shí)

對(duì)于Verilog描述初學(xué)者來說，最難的莫過于編寫測試代碼并判斷自己寫的是否正確。在這里我推薦一個(gè)HDL描述練習(xí)網(wǎng)站，這個(gè)網(wǎng)站上的練習(xí)題無需自己編寫測試...

2022-08-03 標(biāo)簽：Verilog HDL 代碼 956 0

如何將算法“翻譯”成Verilog？

然而再復(fù)雜的算法，在設(shè)計(jì)工程師的眼里，也就是一堆數(shù)學(xué)公式，算法設(shè)計(jì)者也應(yīng)該盡量做簡單的算法實(shí)現(xiàn)，比如除法，求冪次方、開平方等復(fù)雜運(yùn)算到了設(shè)計(jì)工程師這里都...

2022-11-03 標(biāo)簽：算法 Verilog 940 0

淺析標(biāo)準(zhǔn)的Verilog對(duì)語句有兩種分組方式

標(biāo)準(zhǔn)的Verilog對(duì)語句有兩種分組方式——使用begin…end或fork…join，begin…end中的語句以順序方式執(zhí)行，而fork…join中...

2022-09-14 標(biāo)簽：Verilog 920 0

Ajoy Bose：可重用IP(智能產(chǎn)權(quán))才是新的抽象等級(jí)

2018-07-09 標(biāo)簽：SoC ip Verilog 869 0

基于Verilog HDL的CMOS圖像敏感器驅(qū)動(dòng)電路設(shè)計(jì)

摘要：介紹一種用于衛(wèi)星姿態(tài)測量的CMOS圖像敏感器--STAR250的時(shí)序驅(qū)動(dòng)信號(hào)，并使用Verilog HDL語言設(shè)計(jì)驅(qū)動(dòng)時(shí)序電路。經(jīng)布線、仿真、測...

2009-06-20 標(biāo)簽：Verilog hdl 863 0

$unit聲明空間

對(duì)unit聲明空間中定義的任何更改都需要重新編譯構(gòu)成設(shè)計(jì)和驗(yàn)證測試臺(tái)的所有源代碼，因?yàn)槿魏蔚胤降娜魏挝募伎梢詿o需導(dǎo)入地使用該定義。許多軟件工具不會(huì)強(qiáng)制...

2022-06-21 標(biāo)簽：模塊 Verilog 編譯 799 0

智能行業(yè)將數(shù)據(jù)放在首位

　　雖然過去機(jī)器銷售是他們的主要業(yè)務(wù)，但創(chuàng)新的機(jī)器制造商已經(jīng)開始向客戶提供預(yù)測性維護(hù)服務(wù)合同，以減少生產(chǎn)線停機(jī)。該行業(yè)越來越多的參與者將重點(diǎn)轉(zhuǎn)向服務(wù)收入...

2022-09-10 標(biāo)簽：傳感器 Verilog vhdl 755 0

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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QUARTUS II

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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