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Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog資訊

verilog中阻塞賦值和非阻塞賦值

阻塞和非阻塞語(yǔ)句作為verilog HDL語(yǔ)言的最大難點(diǎn)之一，一直困擾著FPGA設(shè)計(jì)者，即使是一個(gè)頗富經(jīng)驗(yàn)的設(shè)計(jì)工程師，也很容易在這個(gè)點(diǎn)上犯下一些不必要...

2011-03-15 標(biāo)簽：verilog 阻塞賦值非阻塞賦值 7015 1

基于Verilog實(shí)現(xiàn)的DDS任意波形發(fā)生器

DDS是從相位的概念直接合成所需波形的一種頻率合成技術(shù)。不僅可以產(chǎn)生不同頻率的正弦波，而且可以控制波形的初始相位。本文為大家介紹基于Verilog實(shí)現(xiàn)的...

2018-01-08 標(biāo)簽：Verilog 任意波形發(fā)生器 6866 0

以AD9249介紹其3線SPI配置的verilog實(shí)現(xiàn)

3線SPI的時(shí)鐘產(chǎn)生方式和上一篇的4線SPI相同，這里不在敘述。兩者的不同點(diǎn)在于：三線SPI模式需要FPGA管腳三態(tài)控制SDIO的輸入/輸出狀態(tài)。下圖所...

2020-09-07 標(biāo)簽：fpga Verilog SPI 6608 0

Verilog HDL為門(mén)級(jí)電路建模的能力詳解

門(mén)電平模型化本章講述Verilog HDL為門(mén)級(jí)電路建模的能力，包括可以使用的內(nèi)置基本門(mén)和如何使用它們來(lái)進(jìn)行硬件描述。 5.1 內(nèi)置基本門(mén) Veril...

2021-03-05 標(biāo)簽：電路 Verilog HDL 6554 0

好用的Verilog串口UART程序

==========================================================================//...

2010-06-05 標(biāo)簽：Verilog uart 6370 1

Verilog寫(xiě)法：組合邏輯+時(shí)序邏輯

這種寫(xiě)法沒(méi)什么問(wèn)題，但是有一點(diǎn)，覆蓋率不好收，如果一些情況沒(méi)跑到需要一個(gè)個(gè)分析。覆蓋率會(huì)把數(shù)據(jù)信號(hào)當(dāng)作一個(gè)情況列出來(lái)，比如數(shù)據(jù)信號(hào)data沒(méi)出現(xiàn)過(guò)0 的...

2022-07-07 標(biāo)簽：寄存器比較器 Verilog 6355 0

簡(jiǎn)述Verilog HDL中阻塞語(yǔ)句和非阻塞語(yǔ)句的區(qū)別

? 在Verilog中有兩種類(lèi)型的賦值語(yǔ)句：阻塞賦值語(yǔ)句（“=”）和非阻塞賦值語(yǔ)句（“=”）。正確地使用這兩種賦值語(yǔ)句對(duì)于Verilog的設(shè)計(jì)和仿真非常...

2021-12-02 標(biāo)簽：Verilog HDL 阻塞 6306 0

Verilog是編程語(yǔ)言嗎

知乎上刷到一個(gè)問(wèn)題，問(wèn)性能最強(qiáng)的編程語(yǔ)言是什么？看到高贊回答到是Verilog，然后在評(píng)論區(qū)就引發(fā)了一場(chǎng)Verilog到底算不算編程語(yǔ)言的爭(zhēng)論，我覺(jué)得比...

2021-08-23 標(biāo)簽：Verilog 編程 6255 0

Verilog代碼命名六大黃金規(guī)則

電子發(fā)燒友網(wǎng)核心提示：關(guān)于Verilog代碼中命名的六大黃金規(guī)則。 1. 系統(tǒng)級(jí)信號(hào)的命名。系統(tǒng)級(jí)信號(hào)指復(fù)位信號(hào)，置位信號(hào)，時(shí)鐘信號(hào)等需要輸送到各個(gè)...

2012-09-04 標(biāo)簽：Verilog 代碼 6171 1

自動(dòng)連線的神器——emacs verilog mode

Verilog－mode是由Michael McNamara mac＠verilog．com和Wilson Snyder wsnyder＠wsnyder...

2022-03-29 標(biāo)簽：Verilog 編輯器 6152 0

FPGA中如何使用Verilog處理圖像

該FPGA項(xiàng)目旨在詳細(xì)展示如何使用Verilog處理圖像，從Verilog中讀取輸入位圖圖像（.bmp），處理并將處理結(jié)果寫(xiě)入Verilog中的輸出位圖...

2021-09-23 標(biāo)簽：fpga Verilog HDL 6139 0

verilog的signed類(lèi)型有哪些?

在數(shù)字電路中，出于應(yīng)用的需要，我們可以使用無(wú)符號(hào)數(shù)，即包括0及整數(shù)的集合；也可以使用有符號(hào)數(shù)，即包括0和正負(fù)數(shù)的集合。在更加復(fù)雜的系統(tǒng)中，也許這兩種類(lèi)型...

2020-01-30 標(biāo)簽：verilog 數(shù)字電路 6101 0

X態(tài)產(chǎn)生的原因主要分為哪幾種情況

在Verilog中，IC設(shè)計(jì)工程師使用RTL構(gòu)造和描述硬件行為。但是RTL代碼中的一些語(yǔ)義，并不能夠準(zhǔn)確地為硬件行為建模。

2022-09-21 標(biāo)簽：Verilog RTL 觸發(fā)器 6044 0

基于二值圖像的濾波算法即形態(tài)學(xué)濾波

形態(tài)學(xué)濾波由腐蝕和膨脹兩種操作組成。首先，腐蝕（Erosion）的核心思想是圖像像素之間進(jìn)行邏輯與運(yùn)算，簡(jiǎn)單來(lái)說(shuō)，當(dāng)一個(gè)包含當(dāng)前像素的結(jié)構(gòu)單元的像素值都...

2021-03-09 標(biāo)簽：Verilog 濾波算法二值圖像 5673 0

SystemVerilog中數(shù)組的賦值、索引和切片

數(shù)組可以作為參數(shù)傳遞給子程序，當(dāng)數(shù)組作為值傳遞給子程序時(shí)，會(huì)將這個(gè)數(shù)組復(fù)制一份傳遞給子程序。

2022-10-20 標(biāo)簽：Verilog 數(shù)組 5435 0

Verilog進(jìn)行組合邏輯設(shè)計(jì)時(shí)有哪些注意事項(xiàng)

一、邏輯設(shè)計(jì) （1）組合邏輯設(shè)計(jì) 下面是一些用Verilog進(jìn)行組合邏輯設(shè)計(jì)時(shí)的一些注意事項(xiàng)： ①組合邏輯可以得到兩種常用的RTL 級(jí)描述方式。第一種是...

2021-06-23 標(biāo)簽：fpga 寄存器 Verilog 5430 0

Verilog有哪幾個(gè)版本？怎樣去寫(xiě)出它？

眾所周知，用于FPGA開(kāi)發(fā)的硬件描述語(yǔ)言（HDL）主要有兩種：Verilog和VHDL。

2021-06-15 標(biāo)簽：Verilog vhdl 5289 0

Verilog代碼編輯仿真驗(yàn)證平臺(tái)分享

打開(kāi)后的界面如下圖所示，全英文顯示。如果感覺(jué)自己的英文水平欠佳，可以使用谷歌瀏覽器打開(kāi)該網(wǎng)頁(yè)，并選擇在線翻譯功能，翻譯的正確率還是很高的。

2020-10-23 標(biāo)簽：Verilog verilog代碼 5267 0

快速理解Verilog語(yǔ)言

Verilog HDL簡(jiǎn)稱(chēng)Verilog，它是使用最廣泛的硬件描述語(yǔ)言。

2020-03-22 標(biāo)簽：Verilog 5093 0

Verilog HDL語(yǔ)言實(shí)現(xiàn)時(shí)序邏輯電路

Verilog HDL語(yǔ)言實(shí)現(xiàn)時(shí)序邏輯電路在Verilog HDL語(yǔ)言中，時(shí)序邏輯電路使用always語(yǔ)句塊來(lái)實(shí)現(xiàn)。例如，實(shí)現(xiàn)一個(gè)帶有異步復(fù)位信號(hào)的D觸發(fā)器

2010-02-08 標(biāo)簽：HD Verilog 4739 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

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識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
PCB封裝庫(kù)

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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candence

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
驅(qū)動(dòng)電流

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
FPGA教程

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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紅外觸摸屏

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