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      pcie

      pcie

      +關(guān)注15人關(guān)注

      PCI-Express（peripheral component interconnect express）是一種高速串行計算機擴展總線標(biāo)準，它原來的名稱為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線標(biāo)準。

      文章：1039個 瀏覽：82906次 帖子：294個

      pcie技術(shù)

      物理層電氣部分基礎(chǔ)

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      需要注意的是，PCIe總線采用的是嵌入式時鐘，即只有數(shù)據(jù)Lane，并沒有時鐘Lane（具體在前面的文章中已經(jīng)詳細地介紹過了）。也就是說，以Gen1為例，...

      2018-06-09 標(biāo)簽：芯片PCIe物理層 4868 0

      對LTSSM進行了簡單的介紹

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      這是鏈路（Link）的正常狀態(tài)（Normal and Full-Active State），所有的TLP、DLLP和Ordered Sets都可以被正常...

      2018-06-08 標(biāo)簽：PCIe鏈路功耗管理 1.5萬 0

      PCIe中的信號補償技術(shù)——De-emphasis

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      此時，還存在另一個問題，由于壓擺率的特性，如果系統(tǒng)中出現(xiàn)幾個連續(xù)的1（或者0），而接下來的信號為0（或者1）時，信號的電壓可能達不到要求，如下圖所示。這...

      2018-06-06 標(biāo)簽：信號PCIe物理層 1.9萬 0

      PCIe SSD推動全新閃存時代到來

      一個明顯趨勢是能耗的總量和增速都在快速變化，很多地方政府本著發(fā)展地方經(jīng)濟和產(chǎn)業(yè)轉(zhuǎn)型的目標(biāo)，還是較為積極的發(fā)展和支持云計算與數(shù)據(jù)中心產(chǎn)業(yè)，比如內(nèi)蒙古、重慶...

      2018-06-05 標(biāo)簽：SSDPCIe 2956 0

      PCIe總線中的鏈路初始化與訓(xùn)練

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      前面的文章中介紹過，PCIe收發(fā)的都是差分信號，有的時候Link兩端的設(shè)備的對應(yīng)信號的極性可能是相反的。因此，PCIe Spec允許在鏈路訓(xùn)練與初始化的...

      2018-06-05 標(biāo)簽：嵌入式總線PCIe 1.1萬 0

      聊一聊接收端物理層邏輯子層的實現(xiàn)細節(jié)

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      如果鏈路（Link）處于低功耗狀態(tài)（比如L0s或者L1）時，接收端此時會失去同步（即Losing Bit Lock）。為了避免物理層認為這是一個錯誤（異...

      2018-06-03 標(biāo)簽：PCIe物理層 3840 0

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      前面的文章中提到過Ordered Sets，其主要用于鏈路訓(xùn)練等。每一個Ordered Set都是按照DW對齊的（即四個字節(jié)），且Ordered Set...

      2018-06-01 標(biāo)簽：PCIe物理層 6241 0

      PCIe物理層實現(xiàn)了一對收發(fā)差分對，可以實現(xiàn)全雙工的通信方式

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      如上圖所示，PCIe物理層實現(xiàn)了一對收發(fā)差分對，因此可以實現(xiàn)全雙工的通信方式。需要注意的是，PCIe Spec只是規(guī)定了物理層需要實現(xiàn)的功能、性能與參數(shù)...

      2018-05-31 標(biāo)簽：全雙工PCIe物理層 1.4萬 0

      Ack/Nak機制詳細介紹

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      Ack/Nak是一種由硬件實現(xiàn)的，完全自動的機制，目的是保證TLP有效可靠地傳輸。Ack DLLP用于確認TLP被成功接收，Nak DLLP則用于表明T...

      2018-05-29 標(biāo)簽：AckPCIeNak 1.5萬 0

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      大數(shù)據(jù)和云計算時代背景下，數(shù)據(jù)中心和骨干網(wǎng)支撐著海量數(shù)據(jù)的計算和交互。而海量的數(shù)據(jù)則源自于無數(shù)的手機和終端個體，如何加速海量數(shù)據(jù)和信息的收集和匯聚？

      2018-05-24 標(biāo)簽：HDMIPCIE 7549 0

      Flow Control機制可以顯著地提高總線的傳輸效率

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      PCIe Spec規(guī)定，PCIe設(shè)備的每一個端口（Ports）都必須支持Flow Control機制，在發(fā)送TLP之前，F(xiàn)low Control必須先檢...

      2018-05-24 標(biāo)簽：總線PCIe 7174 0

      PCIe總線必須要先完成Flow Control初始化

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      由于VC0是默認使能的，所以當(dāng)Flow Control初始化開始時，其會被自動的初始化。其他的Virtual Channel是可選的，只有當(dāng)被配置為使能...

      2018-05-24 標(biāo)簽：總線PCIe數(shù)據(jù)鏈路層 7977 0

      xilinx sp605 PCIe EDK使用方法（之一：EDK設(shè)置部分）視頻教程

      在EDK環(huán)境中針對在xilinx sp605 PCIe開發(fā)板，舉一個簡單的例子，介紹如何使用PCIE核與PC進行數(shù)據(jù)通訊。

      2018-06-07 標(biāo)簽：fpgaXilinxPCIe 5725 0

      ise設(shè)計流程視頻教程

      xilinx的ise的使用流程，簡單介紹

      2018-06-06 標(biāo)簽：fpgaXilinxPCIe 3682 0

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      作為一個初學(xué)者，有的時候很難弄清楚ISE如何使用，本視頻教程以一種最簡單的方式展示如何使用ISE來開發(fā)一個XILINX FPGA工程。由于錄屏的原因，本...

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      2018-06-06 標(biāo)簽：dspfpgaXilinx 3961 0

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      TLP的類型和路由方式由Fmt和Type所決定，這在前面關(guān)于TLP路由的文章中已經(jīng)詳細的介紹過。上圖顯示的是各種不同格式的TLP Header的相同的部分。

      2018-05-17 標(biāo)簽：電平PCIeTLP 9472 0

      實測：高性能PCIe通道固態(tài)硬盤帶來的實際影響

      這幾款游戲都是目前比較熱門的游戲大作，有著大型的場景需要加載。因此測試以點擊進入游戲開始計時，到完全進入可操作界面為止，分別進行時間統(tǒng)計。

      2018-05-16 標(biāo)簽：PCIe固態(tài)硬盤 1.9萬 0

      分析一下PortB的Header中的Base & Limit寄存器

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      需要注意的是，Endpoint的需要的NP-MMIO的大小明明只有4KB，PortB的Header卻給其1MB的空間（最小1MB），也就是說剩余的空間都...

      2018-05-11 標(biāo)簽：寄存器PCIe 6719 0

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      • Protues
        Protues
        +關(guān)注
        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
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        靜電防護
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        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
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        FPGA芯片
        +關(guān)注
        FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。
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        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強，編程門檻降低，即使沒有編程經(jīng)驗的人也可以嘗試給Arduino控制器編寫程序。
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        +關(guān)注
        FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費者所需的新一代汽車。
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        +關(guān)注
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        　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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        面包板是由于板子上有很多小插孔，專為電子電路的無焊接實驗設(shè)計制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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        AXI
        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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        時鐘源
        +關(guān)注
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      • 驅(qū)動電流
        驅(qū)動電流
        +關(guān)注
      • FPGA教程
        FPGA教程
        +關(guān)注
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        Kintex-7
        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實現(xiàn)與其相當(dāng)性能，性價比提高了一倍，功耗降低了一半。
      • AD采樣
        AD采樣
        +關(guān)注
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        Protel DXP
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