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      標(biāo)簽　>　Vitis

      Vitis

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      Vitis Model Composer 是一款 Xilinx 工具包，支持在 MATALB? 和 Simulink? 環(huán)境中進(jìn)行快速設(shè)計(jì)探索和驗(yàn)證，并加速 Xilinx 器件的量產(chǎn)。

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      Vitis簡(jiǎn)介

      　　Vitis Model Composer 是一款 Xilinx 工具包，支持在 MATALB? 和 Simulink? 環(huán)境中進(jìn)行快速設(shè)計(jì)探索和驗(yàn)證，并加速 Xilinx 器件的量產(chǎn)。

      　　使用針對(duì) AI 引擎和可編程邏輯的優(yōu)化模塊，創(chuàng)建設(shè)計(jì)?？梢暬抡娼Y(jié)果并對(duì)其進(jìn)行分析，然后將得出的結(jié)果與使用 MALTAB? 和 Simulink? 生成的黃金參考進(jìn)行比較。

      • 　　無(wú)縫協(xié)同仿真 AI 引擎及可編程邏輯（HLS、HDL）模塊。
      • 　　自動(dòng)生成代碼（AI 引擎數(shù)據(jù)流程圖、RTL、HLS C++）及設(shè)計(jì)測(cè)試臺(tái)。
      • 　　在硬件驗(yàn)證設(shè)計(jì)，具有與無(wú)與倫比的易用性。

      　　Vitis 統(tǒng)一軟件平臺(tái)包括：

      • 　　全面的內(nèi)核開發(fā)套件，可無(wú)縫構(gòu)建加速的應(yīng)用
      • 　　完整的硬件加速開源庫(kù)，針對(duì) Xilinx FPGA 和 Versal ACAP 硬件平臺(tái)進(jìn)行了優(yōu)化
      • 　　插入特定領(lǐng)域的開發(fā)環(huán)境，可直接在熟悉的更高層次框架中進(jìn)行開發(fā)
      • 　　不斷發(fā)展的硬件加速合作伙伴庫(kù)和預(yù)建應(yīng)用生態(tài)系統(tǒng)
      • 　　Vitis Model Composer 是一款基于模型的設(shè)計(jì)工具，支持在 MathWorks MATALB? 和 Simulink? 環(huán)境中進(jìn)行快速設(shè)計(jì)探索和驗(yàn)證，并加速 Xilinx 器件的量產(chǎn)。
      • 　　Vitis Networking P4 允許創(chuàng)建軟定義網(wǎng)絡(luò)。VitisNetP4 數(shù)據(jù)平面構(gòu)建器生成的系統(tǒng)可以針對(duì)從簡(jiǎn)單的數(shù)據(jù)包分類到復(fù)雜的數(shù)據(jù)包編輯的各種數(shù)據(jù)包處理功能進(jìn)行編程。
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      vitis知識(shí)

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        擬訂科創(chuàng)板股票上市審核規(guī)則、科創(chuàng)板上市公司并購(gòu)重組審核規(guī)則、上市委員會(huì)及科技創(chuàng)新咨詢委員會(huì)相關(guān)規(guī)則；負(fù)責(zé)科創(chuàng)板股票發(fā)行上市審核和科創(chuàng)板上市公司并購(gòu)重組審核工作，擬訂審核標(biāo)準(zhǔn)、審核程序等；對(duì)發(fā)行人、科創(chuàng)板上市公司及中介機(jī)構(gòu)進(jìn)行自律監(jiān)管等。
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