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標(biāo)簽 > Verilog語(yǔ)言
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epoll的觸發(fā)模式是個(gè)引發(fā)討論非常多的話題,網(wǎng)絡(luò)上這方面總結(jié)的文章也很多,首先從名字上就不是很統(tǒng)一,LT模式常被稱為水平觸發(fā)、電平觸發(fā)、條件觸發(fā),而E...
驗(yàn)證環(huán)境搭建時(shí),常使用plusargs和plusargs從仿真命令中接收參數(shù),用于動(dòng)態(tài)地改變驗(yàn)證組件的行為,比如是否需要打開VIP,是否需要自動(dòng)chec...
2023-10-20 標(biāo)簽:仿真器Verilog語(yǔ)言 1090 0
FPGA設(shè)計(jì)之Verilog中clk為什么要用posedge而不用negedge?
Verilog是一種硬件描述語(yǔ)言,用于描述數(shù)字電路的行為和特性。在Verilog中,時(shí)鐘信號(hào)(clk)和線路是非常重要的,它用于同步電路中的各個(gè)模塊,確...
2023-10-10 標(biāo)簽:同步電路FPGA芯片時(shí)鐘信號(hào) 3823 0
認(rèn)識(shí)一下幾個(gè)常用的門級(jí)電路
標(biāo)準(zhǔn)單元庫(kù)是數(shù)字集成電路的積木,是復(fù)雜電路和系統(tǒng)的基礎(chǔ)。今天我們來(lái)認(rèn)識(shí)一下其中的幾個(gè)常用門級(jí)電路。
2023-10-09 標(biāo)簽:Verilog語(yǔ)言門級(jí)電路 1781 0
Alpha 通道**是一個(gè) **8 **位的灰度通道,該通道采用** 2^8 = 256 **級(jí)灰度來(lái)記錄圖像中的透明度信息
2023-10-09 標(biāo)簽:AlphaVerilog語(yǔ)言 716 0
高級(jí)數(shù)字IC設(shè)計(jì)之灰度轉(zhuǎn)二值化設(shè)計(jì)
這是一個(gè)能夠成功上板實(shí)現(xiàn)的灰度轉(zhuǎn)二值的 Verilog 程序設(shè)計(jì),詳細(xì)的數(shù)據(jù)延時(shí)與信號(hào)延時(shí)如下所示
2023-10-09 標(biāo)簽:IC設(shè)計(jì)RGBVerilog語(yǔ)言 399 0
SystemVerilog中的聯(lián)合(union)介紹
在 SystemVerilog 中,聯(lián)合只是信號(hào),可通過(guò)不同名稱和縱橫比來(lái)加以引用。
2023-10-08 標(biāo)簽:RTLVerilog語(yǔ)言 1400 0
Bluespec SytemVerilog握手協(xié)議接口轉(zhuǎn)換設(shè)計(jì)實(shí)現(xiàn)
由于接口控制信號(hào)上的差異,要實(shí)現(xiàn)Bluespec SystemVerilog(BSV)生成的代碼和外部Verilog代碼之間的正確交互是一件比較麻煩同時(shí)...
2023-10-08 標(biāo)簽:控制器AXI總線Verilog語(yǔ)言 581 0
看一下SystemVerilog中package的使用方法與注意事項(xiàng)
談到package,用過(guò)VHDL的工程師并不陌生。實(shí)際上,SystemVerilog中的package正是從VHDL引入的,以進(jìn)一步增強(qiáng)其在系統(tǒng)級(jí)的描述能力。
2023-10-07 標(biāo)簽:VivadoVerilog語(yǔ)言sub 2547 0
systemverilog:logic比reg更有優(yōu)勢(shì)?
在systemverilog協(xié)議中,logic定義四態(tài)值,即向量(vector)的每個(gè)位(bit)可以是邏輯0, 1, Z或X,與verilog協(xié)議中的...
2023-09-28 標(biāo)簽:驅(qū)動(dòng)器仿真器RTL 2529 0
類別:FPGA/ASIC 2016-11-10 標(biāo)簽:Verilog語(yǔ)言 641 0
類別:FPGA/ASIC 2016-11-10 標(biāo)簽:Verilog語(yǔ)言 569 0
類別:單片機(jī) 2016-08-05 標(biāo)簽:FPGA電子Verilog語(yǔ)言 590 0
Verilog HDL硬件描述語(yǔ)言_Verilog語(yǔ)言要素立即下載
類別:FPGA/ASIC 2016-04-25 標(biāo)簽:Verilog語(yǔ)言 726 0
基于verilog語(yǔ)言的數(shù)字頻率計(jì)設(shè)計(jì)立即下載
類別:課件下載 2015-12-08 標(biāo)簽:verilog語(yǔ)言數(shù)字頻率計(jì)設(shè)計(jì) 1341 0
類別:FPGA/ASIC 2015-11-10 標(biāo)簽:verilog語(yǔ)言 818 0
類別:實(shí)用工具 2015-07-23 標(biāo)簽:verilog語(yǔ)言 464 0
Verilog語(yǔ)言實(shí)現(xiàn)交通燈程序立即下載
類別:C語(yǔ)言|源代碼 2015-07-23 標(biāo)簽:Verilog語(yǔ)言 293 0
類別:FPGA/ASIC 2015-06-25 標(biāo)簽:FPGAVerilog HDLVerilog語(yǔ)言 650 1
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