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      標(biāo)簽　>　Verilog

      Verilog

      +關(guān)注28人關(guān)注

      Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

      文章：1363個(gè) 視頻：652個(gè) 瀏覽：111340次 帖子：930個(gè)

      verilog技術(shù)

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      在實(shí)際電路中存在兩種延遲，慣性延遲 (Inertial delay) 和傳導(dǎo)延遲 (Transport delay)。

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      本文詳細(xì)闡述了在一個(gè)testbench中，應(yīng)該如何使用阻塞賦值與非阻塞賦值。首先說結(jié)論，建議在testbench中，對時(shí)鐘信號(hào)...

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      2025-04-11 標(biāo)簽：模塊Verilog波形 119 0

      FPGA Verilog HDL語法之編譯預(yù)處理

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      Verilog HDL語言和C語言一樣也提供了編譯預(yù)處理的功能。“編譯預(yù)處理”是Verilog HDL編譯系統(tǒng)的一個(gè)組成部分。Verilog HDL語言...

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      2025-03-27 標(biāo)簽：FPGA集成電路Verilog 475 0

      基于Verilog語言實(shí)現(xiàn)CRC校驗(yàn)

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      CRC即循環(huán)冗余校驗(yàn)碼：是數(shù)據(jù)通信領(lǐng)域中最常用的一種查錯(cuò)校驗(yàn)碼，其特征是信息字段和校驗(yàn)字段的長度可以任意選定。循環(...

      2025-03-24 標(biāo)簽：crcVerilog校驗(yàn)碼 905 0

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      邊沿檢測經(jīng)常用于按鍵輸入檢測電路中，按鍵按下時(shí)輸入信號(hào) key 變?yōu)榈碗娖剑存I抬起變?yōu)楦唠娖?。?dāng)輸入的信號(hào)為理想的...

      2025-03-19 標(biāo)簽：寄存器Verilog邊沿檢測 506 0

      一文詳解Verilog HDL

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      Verilog HDL（Hardware Description Language）是一種硬件描述語言，用于從算法級(jí)、門級(jí)到開關(guān)級(jí)的多種抽象設(shè)計(jì)...

      2025-03-17 標(biāo)簽：FPGA寄存器Verilog 1061 0

      根據(jù)波形圖編寫Verilog代碼

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      根據(jù)下面的時(shí)序圖實(shí)現(xiàn)這個(gè)組合邏輯電路。

      2025-02-17 標(biāo)簽：Verilog波形圖組合邏輯電路 348 0

      淺談Verilog和VHDL的區(qū)別

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      2023-09-21 標(biāo)簽：Verilog數(shù)字電路運(yùn)算符 2955 0

      一本Verilog HDL代碼對應(yīng)電路的書，助你快速編寫可綜合模型

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        特性阻抗
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      • 驅(qū)動(dòng)電流
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