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本文介紹了神經(jīng)網(wǎng)絡(luò)VLSI硬件實現(xiàn)的基本情況和VerilgHDL硬件設(shè)計方法的概念，在此基礎(chǔ)上利用FPGA設(shè)計出了Kohonen競爭網(wǎng)絡(luò)硬件電路，其工作頻率為33Mhz，并對其工作過程進(jìn)行了較詳細(xì)的分析，給出了綜合仿真的測試結(jié)果。
關(guān)鍵詞：神經(jīng)網(wǎng)絡(luò)硬件實現(xiàn) Kohonen競爭網(wǎng)絡(luò)算法 VerilgHDL FPGA
Abstract: This paper introduces the basic complexion of neural network VLSI hardware realization and the concept of VerilgHDL hardware’s design. Based on that, it designs Kohonen competitive network hardware circuit by utilizing FPGA, which working frequency is 33Mhz. Then in this paper detailedly analyses its working process, and provides the testing result of integrated simulation.
Keywords: neural network hardware realization; Kohonen competitive network arithmetic; VerilgHDL; FPGA
關(guān)鍵詞：神經(jīng)網(wǎng)絡(luò)硬件實現(xiàn) Kohonen競爭網(wǎng)絡(luò)算法 VerilgHDL FPGA
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