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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>模擬數(shù)字論文>基于FPGA的8051CPU核的設(shè)計(jì)

      基于FPGA的8051CPU核的設(shè)計(jì)

      2015-10-29 | pdf | 7620KB | 次下載 | 1積分

      資料介紹

      本論文設(shè)計(jì)完成的8051CPU核在最高時(shí)鐘頻率和指令執(zhí)行效率指標(biāo)上均優(yōu) 于傳統(tǒng)的MCS-51內(nèi)核。由于該核使用VHDL語(yǔ)言描述，可讀性好，易于擴(kuò)展使用， 易于升級(jí)，適用于基于IP核復(fù)用技術(shù)的SOPC設(shè)計(jì)，因此，比較有適用價(jià)值。
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