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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>嵌入式技術(shù)論文>基于FPGA高速數(shù)據(jù)采集與傳輸?shù)穆暦鶞y井系統(tǒng)

      基于FPGA高速數(shù)據(jù)采集與傳輸?shù)穆暦鶞y井系統(tǒng)

      2011-12-22 | pdf | 617 KB | 次下載 | 免費

      資料介紹

      該設(shè)計系統(tǒng)采用高速AD轉(zhuǎn)換,以靈活、高效性價比FPGA芯片-EP1C6為平臺,利用USB傳輸,實現(xiàn)了基于Verilog 的聲幅測井系統(tǒng)。最終,在上位機得到的聲幅測井曲線用來判斷固井質(zhì)量。在水泥膠結(jié)良好時,固井聲幅測井值低;水泥膠結(jié)差時,固井聲幅測井值高。

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