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本文基于目前SOC系統(tǒng)技術(shù)的發(fā)展情況，設(shè)計(jì)一個(gè)可用于SOC系統(tǒng)的核，該核的指令集
完全兼容于MCS-51系列的微控制器。本設(shè)計(jì)的目的在于提高M(jìn)CS-51的指令執(zhí)行速度的同時(shí)兼顧面積的考慮，提升其在Soc系統(tǒng)中的應(yīng)用價(jià)值。該IPCORE采用數(shù)據(jù)總線和指令總線相分離的哈佛總線結(jié)構(gòu)和全新的指令時(shí)序以及指令實(shí)現(xiàn)方式，并使用PLA硬布線邏輯代替微程序控制，加快了核的速度，提高了指令執(zhí)行效率。所有的模塊都采用vhdl硬件描述語言進(jìn)行設(shè)計(jì)描述，使用EDA工具進(jìn)行功能仿真、綜合。
完全兼容于MCS-51系列的微控制器。本設(shè)計(jì)的目的在于提高M(jìn)CS-51的指令執(zhí)行速度的同時(shí)兼顧面積的考慮，提升其在Soc系統(tǒng)中的應(yīng)用價(jià)值。該IPCORE采用數(shù)據(jù)總線和指令總線相分離的哈佛總線結(jié)構(gòu)和全新的指令時(shí)序以及指令實(shí)現(xiàn)方式，并使用PLA硬布線邏輯代替微程序控制，加快了核的速度，提高了指令執(zhí)行效率。所有的模塊都采用vhdl硬件描述語言進(jìn)行設(shè)計(jì)描述，使用EDA工具進(jìn)行功能仿真、綜合。
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