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提出了先進(jìn)行前一級4點(diǎn)蝶形運(yùn)算,再進(jìn)行本級與旋轉(zhuǎn)因子復(fù)乘運(yùn)算的結(jié)構(gòu),合理地利用了硬件資源。對系統(tǒng)劃分的各個(gè)模塊使用Verilog HDL進(jìn)行編碼設(shè)計(jì)。對整個(gè)系統(tǒng)整合后的代碼進(jìn)行功能驗(yàn)證之后,采用Quartus Ⅱ與Matlab進(jìn)行聯(lián)合仿真,其結(jié)果是一致的。該系統(tǒng)既有DSP器件實(shí)現(xiàn)的靈活性又有專用FFT芯片實(shí)現(xiàn)的高速數(shù)據(jù)吞吐能力,在數(shù)字信號處理領(lǐng)域有廣泛應(yīng)用。
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