資料介紹
簡介:該設(shè)計(jì)系統(tǒng)采用高速AD轉(zhuǎn)換,以靈活、高效性價(jià)比FPGA芯片-EP1C6為平臺(tái),利用USB傳輸,實(shí)現(xiàn)了基于Verilog 的聲幅測(cè)井系統(tǒng)。最終,在上位機(jī)得到的聲幅測(cè)井曲線用來判斷固井質(zhì)量。在水泥膠結(jié)良好時(shí),固井聲幅測(cè)井值低;水泥膠結(jié)差時(shí),固井聲幅測(cè)井值高。
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