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鑒于內(nèi)核、存儲器、I/O 以及其它電軌的過多電壓電流要求，多核 DSP 實施需要智能電源管理。DSP 內(nèi)核電壓電源的一個重要性能基準就是能夠根據(jù)DSP 使用情況及環(huán)境條件實時調(diào)節(jié) VCORE。VCORE 命令一般以數(shù)字格式提供，電源應能隨時解讀。VCORE 電軌一般具有最大的電流規(guī)范，而能夠平衡效率與尺寸的小型電源解決方案也很重要。關鍵在于在 DSP 與模擬 PWM 級之間使用低成本接口來實現(xiàn)這一電壓識別 (VID) 功能。
因此，下圖提供了將內(nèi)核電軌標示為 CVDD 的多核 DSP 加以說明。同時，我也在《EDN》雜志上發(fā)表了一篇題為《通過調(diào)節(jié)穩(wěn)壓器優(yōu)化 DSP 功率預算》的文章，深入探討這一主題。
一個額定電流為 15A 的 500KHz 降壓轉(zhuǎn)換器負責為 CVDD 供電。該設計可使用連接至 VID 編程器的 4 線數(shù)字接口實現(xiàn) VID 控制，其可直接連接至任何模擬功率級或控制器…
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