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      電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開發(fā)>設(shè)計(jì)的帶嵌入式收發(fā)器的Gen1×1硬核IP的 PCI Express IP編譯器

      設(shè)計(jì)的帶嵌入式收發(fā)器的Gen1×1硬核IP的 PCI Express IP編譯器

      2021-07-30 | rar | 6.32MB | 次下載 | 2積分

      資料介紹

      設(shè)計(jì)的帶嵌入式收發(fā)器的Gen1×1硬核IP的 PCI Express IP編譯器-

      在Cyclone IV GX收發(fā)器入門套件上,設(shè)計(jì)帶嵌入式收發(fā)器的Gen1×1硬核IP的 PCI Express IP編譯器。.rar

      部分文件列表

      文件名文件大小修改時(shí)間
      PCIe_Lab/.qsys_edit/filters.xml1KB2012-02-23 16:48:30
      PCIe_Lab/.qsys_edit/preferences.xml1KB2012-02-23 17:14:12
      PCIe_Lab/altgx_reconfig.v21KB2011-10-28 02:51:56
      PCIe_Lab/c4gx_qsys/synthesis/c4gx_qsys.qip22KB2012-02-23 17:17:06
      PCIe_Lab/c4gx_qsys/synthesis/c4gx_qsys.v459KB2012-02-23 17:14:52
      PCIe_Lab/c4gx_qsys/synthesis/submodules/altera_avalon_mm_bridge.v11KB2012-02-23 17:16:16
      PCIe_Lab/c4gx_qsys/synthesis/submodules/altera_avalon_sc_fifo.v31KB2012-02-23 17:15:50
      PCIe_Lab/c4gx_qsys/synthesis/submodules/altera_avalon_st_pipeline_base.v5KB2012-02-23 17:15:52
      PCIe_Lab/c4gx_qsys/synthesis/submodules/altera_avalon_st_pipeline_stage.sv5KB2012-02-23 17:15:54
      PCIe_Lab/c4gx_qsys/synthesis/submodules/altera_irq_clock_crosser.sv2KB2012-02-23 17:15:54
      PCIe_Lab/c4gx_qsys/synthesis/submodules/altera_merlin_arbitrator.sv9KB2012-02-23 17:15:54
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