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      電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開發(fā)>EDA技術(shù)之VerilogHDL語言

      EDA技術(shù)之VerilogHDL語言

      2017-05-22 | pdf | 2182KB | 次下載 | 免費(fèi)

      資料介紹

      嵌入式基于altera的課件

      Verilog HDL門級結(jié)構(gòu)描述

      用于門級描述關(guān)鍵字包括：not（非門）、and（與門）、 nand（與非門）、or（或門）、nor（或非門）、xor（異或門）、xnor（異或非門）、buf（緩沖器）以及bufif1、bufif0、 notif1、notif0等各種三態(tài)門。門級描述語句格式為 《門類型》 ［《驅(qū)動能力》 《延時》 ］（門實例列表）； nand #10 nd1（a，data，clock，clear）; 使用了一個名為nd1的與非門，輸入為data、clock 、clear 。輸出為a，輸出與輸入的延時為10個時間單位

      EDA技術(shù)之VerilogHDL語言

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