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實(shí)現(xiàn)USB2.0接口控制的VHDL源代碼

19532 2008-05-20 | rar | 193 | 次下載 | 10積分

資料介紹

USB2.0接口，opencore提供,僅供參考

This file describes the current status of the checked in HDL code.

set design_files {usbf_crc5 usbf_crc16 usbf_mem_arb usbf_ep_rf usbf_pa usbf_ep_rf_dummy usbf_pd usbf_rf usbf_utmi_ls usbf_utmi_if usbf_idma usbf_pe usbf_wb usbf_pl usbf_top}
set design_name usbf_top
set ac tive_design usbf_top

# Next Statement defines all clocks and resets in the design
set special_net {rst_i clk_i phy_clk}

# Source Directory
set hdl_src_dir ../../rtl/verilog/

更多usb3.0與usb2.0內(nèi)容請(qǐng)?jiān)L問(wèn)http://elecfans.com/zhuanti/usb3.0.html?1323061461

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