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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>電源完整性（PI）設(shè)計(jì)和測(cè)試

      電源完整性（PI）設(shè)計(jì)和測(cè)試

      2020-10-20 | pdf | 3.57 MB | 次下載 | 1積分

      資料介紹

      電源完整性是指電源波形的質(zhì)量，研究的是電源分配網(wǎng)絡(luò)(PDN)，并從系統(tǒng)供電網(wǎng)絡(luò)綜合考慮，消除或者減弱噪聲對(duì)電源的影響。電源完整性的設(shè)計(jì)目標(biāo)是把電源噪聲控制在運(yùn)行的范圍內(nèi)，為芯片提供干凈穩(wěn)定的電壓，并使它能夠維持在一個(gè)很小的容差范圍內(nèi)(通常為5%以內(nèi))，實(shí)時(shí)響應(yīng)負(fù)載對(duì)電流的快速變化，并能夠?yàn)槠渌?a target='_blank' class='arckwlink_none'>信號(hào)提供低阻抗的回流路徑。電源噪聲的主要來(lái)源：供電模塊(VRM)的輸出噪聲、走線的直流電阻與寄生電感、同步開(kāi)關(guān)噪聲(SSN)、電源與地平面諧振噪聲、臨近電源網(wǎng)絡(luò)耦合噪聲、其他部件耦合噪聲。VRM供電模塊通常包括LDO和DC/DC兩種。
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