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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術>高精度多相時鐘發(fā)生電路設計

      高精度多相時鐘發(fā)生電路設計

      2018-03-15 | rar | 0.28 MB | 次下載 | 免費

      資料介紹

      　　本文設計了一種新穎的單片集成、適用于高速串行通信接口接收端和數(shù)據(jù)恢復電路的等間距高精度五相時鐘發(fā)生電路．基于負反饋動態(tài)調整原理和數(shù)字化的模擬電路設計技術，電路采用TSMC（ Taiwan Semiconduc-tor Manufactunnl; Company Ltd）的CMOSO．25um工藝設計和后仿真，實驗結果表明：時鐘發(fā)生電路可正確輸出五相時鐘，周期均為2.08 m（頻率480 Mbpe）；相互間隔0.416us，抖動為35 ps，鎖定時間為1.8us，滿足高速串行通信接口接收端和數(shù)據(jù)恢復電路對五相時鐘的要求．

      高精度多相時鐘發(fā)生電路設計

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