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      電子發(fā)燒友網(wǎng)>電子資料下載>模擬數(shù)字>CDCE906倍頻性能分析

      CDCE906倍頻性能分析

      2013-09-25 | pdf | 1.59 MB | 次下載 | 免費(fèi)

      資料介紹

      倍頻后的時鐘作為采樣時鐘提供給模數(shù)轉(zhuǎn)換器(ADC)，倍頻帶來的時鐘抖動會限制輸出信噪比的提高。為了盡可能降低時鐘抖動，可以采用專用時鐘合成器實現(xiàn)倍頻。CDCE906是一款高穩(wěn)定性的時鐘合成芯片，時鐘抖動較低。本文提出了CDCE906倍頻在某雷達(dá)信號處理機(jī)中的軟硬件實現(xiàn)，并對倍頻后時鐘進(jìn)行分析，實驗結(jié)果證明其性能優(yōu)于普通FPGA。

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