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文章主要介紹《VMM for SystemVerilog》一書描述的如何利用SystemVerilog語(yǔ)言，采用驗(yàn)證方法學(xué)以及驗(yàn)證庫(kù)開發(fā)出先進(jìn)驗(yàn)證環(huán)境。文章分為四部分，第一部分概述了用SystemVerilog語(yǔ)言驗(yàn)證復(fù)雜SoC的基本方法。第二部分主要介紹使用先進(jìn)驗(yàn)證技術(shù)進(jìn)行RTL驗(yàn)證并定義一個(gè)能在項(xiàng)目之間進(jìn)行驗(yàn)證單元重用的分層驗(yàn)證平臺(tái)結(jié)構(gòu)。第三部分將涉及到系統(tǒng)級(jí)驗(yàn)證，包括SystemVerilog 與SystemC交互等方面。當(dāng)與一個(gè)合適方法相結(jié)合，SystemVerilog提供了建立一個(gè)完整RTL以及系統(tǒng)級(jí)(ESL)驗(yàn)證環(huán)境需要的所有結(jié)構(gòu)及特性。同時(shí)完全支持與System C或與一個(gè)以C為基礎(chǔ)的軟件測(cè)試環(huán)境交互。第四部分討論驗(yàn)證所采用的驗(yàn)證策略，VMM方法學(xué)，以及利用《VMM for SystemVerilog》中定義的標(biāo)準(zhǔn)庫(kù)來(lái)支持方法學(xué)。這些庫(kù)涉及到文章中討論的基本方法，XVC，XVC管理器，軟件驗(yàn)證等方面。
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