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3.4.2 使用VHDL語言設(shè)計(jì)例
Max+plus2軟件支持VHDL語言描述被設(shè)計(jì)電路的邏輯功能,如下舉例說明如何使用該語言設(shè)計(jì)邏輯電路。
例一:設(shè)計(jì)一個(gè)加法器
第一步:進(jìn)入Max+plus2軟件環(huán)境
第二步:建立項(xiàng)目名稱,選擇File/Project/Name菜單
第三步:建立新文件,選擇File/New菜單,進(jìn)入文本編輯器(Text Editor File)窗口
第四步:輸入VHDL語言編寫的源程序,如圖3.4.1所示,這是對(duì)一個(gè)加法器進(jìn)行的描述。輸入完畢后存盤。
第五步:選擇Assign/Device菜單,選定器件。
第六步:選File/Project/Save & Comlile菜單,編譯該VHDL源文件
若有錯(cuò)誤則改錯(cuò),然后再編譯,直至無錯(cuò)編譯成功
第七步:選Max+plus2\Waveform Editor菜單,進(jìn)入波形編輯窗口,編輯輸入波形如圖3.4.2所示。
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