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      電子發(fā)燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>LVDS在FPGA中的使用教程之ALTLVDS TX核外部PLL模式調試

      LVDS在FPGA中的使用教程之ALTLVDS TX核外部PLL模式調試

      2020-12-30 | rar | 0.36 MB | 次下載 | 免費

      資料介紹

      　　lvds連載4博文中，使用的是lvds核調用PLL的方式，這樣一組lvds發(fā)送端口需要一個PLL，比較浪費資源。其實在使用ALTLVDS核時，還可以使用External PLL（外部pll），使用外部pll，不僅可以節(jié)省一個PLL，還可以減少邏輯資源的使用。

      　　下面來說說調用ALTLVDS_TX核時，怎么使用外部PLL。與轉載4相同，還是5個通道，每個通道對應7個解串因子，勾上Use external PLL框，后面Frequency/PLL settings不需要設置，從下圖資源消耗可以看出，使用外部PLL，相對于調用PLL來說，使用更少的reg（198個）。

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