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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用FPGA實(shí)現(xiàn)16位RISC CPU的設(shè)計(jì)

      如何使用FPGA實(shí)現(xiàn)16位RISC CPU的設(shè)計(jì)

      2020-08-17 | rar | 0.39 MB | 次下載 | 免費(fèi)

      資料介紹

      　　RISC_CPU 是一個(gè)復(fù)雜的數(shù)字邏輯電路，但是其基本部件的邏輯并不復(fù)雜，可以將其分成8 個(gè)基本部件來考慮：時(shí)鐘發(fā)生器，指令寄存器，累加器，算術(shù)邏輯運(yùn)算單元，數(shù)據(jù)控制器，狀態(tài)控制器，程序計(jì)數(shù)器，地址多路器。各部件的連接關(guān)系見圖1。其中時(shí)鐘發(fā)生器利用外來時(shí)鐘信號(hào)進(jìn)行分頻生成一系列時(shí)鐘信號(hào)，送往其它部件用作時(shí)鐘信號(hào)。各部件之間的相互操作關(guān)系則由狀態(tài)控制器來控制。

      　　1. 時(shí)鐘發(fā)生器

      　　時(shí)鐘發(fā)生器CLKSOURCE利用外來時(shí)鐘信號(hào)clk 生成一系列時(shí)鐘信號(hào)alu_clk，fetch， 并送往cpu 的其它部件。其中， fetch 是控制信號(hào)， clk 的6 分頻信號(hào)。當(dāng)fetch 高電平時(shí)，使clk 能觸發(fā)cpu 控制器開始執(zhí)行一條指令；同時(shí)fetch 信號(hào)還將控制地址多路器輸出指令地址和數(shù)據(jù)地址。clk 信號(hào)還用作指令寄存器，累加器，狀態(tài)控制器的時(shí)鐘信號(hào)。圖2 為時(shí)鐘發(fā)生器原理圖。時(shí)鐘發(fā)生器的波形如圖3 所示。

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