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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何進行FPGA設(shè)計FPGA設(shè)計向?qū)зY料免費下載

      如何進行FPGA設(shè)計FPGA設(shè)計向?qū)зY料免費下載

      2018-11-02 | rar | 0.04 MB | 次下載 | 免費

      資料介紹

      　　1.考慮器件的資源，包括LE，ram資源，硬件乘法器，PLL，全局時鐘網(wǎng)絡(luò)等。

      　　總體來說，對于FPGA設(shè)計，資源一定要留有余量，否則最后的時序收斂會比較困難。我認(rèn)為使用80%左右是比較合適的。對于資源使用量在95%以上的設(shè)計，除了時序收斂，可能還會遇到一些你想不到的問題。

      ?

      　　A. LE是5K到120K。要對設(shè)計需要的資源做一個估算，120K，對于大部分的應(yīng)用，應(yīng)該是一個很大的數(shù)字了。

      　　B.ram資源為400K-3888Kbit.注意ram塊的大小都是9Kbit，有些模塊，比如fifo，實際上用不到9K的資源。但不管你用多少，都得占用一個ram（有些情況下占用0.5個ram）。所以ram的數(shù)量是否足夠也得考慮。

      　　C.乘法器的數(shù)量 23-288個。注意是18*18bit的乘法器。實際使用時，要看應(yīng)用需要的乘法器精度是多少。

      　　D.PLL的數(shù)量為2-4個。每個PLL可以輸出5個時鐘，一般的設(shè)計夠用了。如果設(shè)計中的時鐘很多，就得仔細(xì)考慮了。

      　　E.全局時鐘網(wǎng)絡(luò)為10-20個。一般夠用，如果設(shè)計中有很多時鐘或者很多扇出（fan-out）很大的信號，比如復(fù)位信號，也得仔細(xì)考慮。
      ?

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