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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>QC-LDPC碼編碼器的FPGA實(shí)現(xiàn)

      QC-LDPC碼編碼器的FPGA實(shí)現(xiàn)

      2015-08-17 | doc | 282KB | 次下載 | 1積分

      資料介紹

      準(zhǔn)循環(huán)低密度奇偶校驗(yàn)(QC-LDPC)碼具有優(yōu)異的糾錯(cuò)性能，已被納入空間數(shù)據(jù)系統(tǒng)咨詢委員會(CCSDS)的近地軌道通信標(biāo)準(zhǔn)。分析了QC-LDPC碼的特點(diǎn)，提出一種基于生成矩陣  的編碼方法。該方法利用循環(huán)矩陣特性簡化生成矩陣的存儲模式，減少了資源消耗;同時(shí)利用循環(huán)移位寄存器和累加器實(shí)現(xiàn)矩陣乘法 ，降低了編碼算法復(fù)雜度。在Xilinx xc4vsx55 FPGA上, 采用VHDL語言實(shí)現(xiàn)了CCSDS標(biāo)準(zhǔn)中(8176,7154)LDPC編碼器的設(shè)計(jì)。仿真結(jié)果表明，設(shè)計(jì)的編碼器資源占用較少，吞吐量約為228Mbit/s。
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