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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的高速FIR數(shù)字濾波器設(shè)計(jì)的改進(jìn)方法_趙岸/顏毅華/陳林杰/劉東浩/王威/陳志軍

      基于FPGA的高速FIR數(shù)字濾波器設(shè)計(jì)的改進(jìn)方法_趙岸/顏毅華/陳林杰/劉東浩/王威/陳志軍

      2015-04-17 | pdf | 1112KB | 次下載 | 2積分

      資料介紹

      在高速有限沖擊響應(yīng)( Finite Impulse Ｒesponse，F(xiàn)IＲ) 數(shù)字濾波器的設(shè)計(jì)中，隨著濾波器階數(shù)的增加，保持?jǐn)?shù)據(jù)流速率和有效使用硬件資源成為設(shè)計(jì)的一個(gè)重點(diǎn)和難點(diǎn)?；诟咚俨⑿杏邢逈_擊響應(yīng)數(shù)字濾波器的基本原理，提出了一種將位平面法、正則有符號(hào)系數(shù)( Canonical-Signed Digit，CSD) 編碼算法和抽取算法應(yīng)用于并行有限沖擊響應(yīng)數(shù)字濾波器的改進(jìn)方法。設(shè)計(jì)通過(guò) Matlab 仿真，在 Quartus II 中編譯、仿真、綜合后下載到現(xiàn)場(chǎng)可編程門(mén)陣列( Field Programmable Gate Array，F(xiàn)PGA) 中進(jìn)行測(cè)試，結(jié)果顯示，這種改進(jìn)方法較好地解決了濾波器階數(shù)和數(shù)據(jù)流速率與硬件資源之間的關(guān)系。
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