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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA設(shè)計(jì)中關(guān)鍵問題

      FPGA設(shè)計(jì)中關(guān)鍵問題

      2011-11-02 | doc | 34 KB | 次下載 | 免費(fèi)

      資料介紹

      隨著FPGA(Field?Programmable?Gate?Array)容量、功能以及可靠性的提高，其在現(xiàn)代數(shù)字通信系統(tǒng)中的應(yīng)用日漸廣泛。采用FPGA設(shè)計(jì)數(shù)字電路已經(jīng)成為數(shù)字電路系統(tǒng)領(lǐng)域的主要設(shè)計(jì)方式之一[１]。在信號(hào)的處理和整個(gè)系統(tǒng)的控制中，F(xiàn)PGA不但能大大縮減電路的體積，提高電路的穩(wěn)定性，而且其先進(jìn)的開發(fā)工具使整個(gè)系統(tǒng)的設(shè)計(jì)調(diào)試周期大大縮短[２～３]。本文結(jié)合作者的經(jīng)驗(yàn)和體會(huì)，指出FPGA設(shè)計(jì)中的一些難點(diǎn)問題，分析問題產(chǎn)生的原因并給出解決方案，有利于FPGA設(shè)計(jì)者少走彎路，在較短的時(shí)間內(nèi)掌握FPGA設(shè)計(jì)技術(shù)。

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