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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的邏輯分析儀的設(shè)計(jì)

      基于FPGA的邏輯分析儀的設(shè)計(jì)

      2011-04-06 | pdf | 1.17 MB | 次下載 | 免費(fèi)

      資料介紹

      在設(shè)計(jì)數(shù)字模擬混合信號(hào)線路的時(shí)候，工程師需要對(duì)數(shù)字部分的邏輯關(guān)系和模擬部分的模擬量進(jìn)行測(cè)試，從而分析數(shù)字邏輯關(guān)系和模擬量。傳統(tǒng)的方法是利用示波器或者邏輯分析儀來(lái)測(cè)試，普通示波器同時(shí)只能測(cè)試一兩路信號(hào)，這對(duì)于分析系統(tǒng)邏輯關(guān)系是不夠的，而邏輯分析儀可以同時(shí)進(jìn)行多路的數(shù)字信號(hào)分析，但是其價(jià)格昂貴。為解決這個(gè)問(wèn)題，筆者設(shè)計(jì)了這個(gè)裝置，通過(guò)友好的圖形界面及圖形化編程語(yǔ)言控制儀器的運(yùn)行，完成對(duì)被測(cè)試量韻采集、分析、判斷、顯示、存儲(chǔ)及數(shù)據(jù)生成。該系統(tǒng)可以作為數(shù)字模擬混合電路測(cè)試和驗(yàn)證的工具，用來(lái)觀察時(shí)序波形、數(shù)字電路功能驗(yàn)證和模擬量的測(cè)試。該裝置成本低廉，儀器的通用性強(qiáng)，在普通邏輯分析儀中占很大比重的控制、顯示、指示等功能由PC完成。從而使該系統(tǒng)具有高性能、低成本、簡(jiǎn)便的使用和擴(kuò)展功能簡(jiǎn)單等優(yōu)勢(shì)。

      FPGA(Field Programmable Gate Array)現(xiàn)場(chǎng)可編程門陣列含有大量的邏輯資源，可以實(shí)現(xiàn)大規(guī)模的時(shí)序和組合邏輯應(yīng)用。而且具有編程靈活、上市時(shí)間短和可重復(fù)編程等特點(diǎn)。在本設(shè)計(jì)中應(yīng)用FPGA要優(yōu)于使用ASIC。

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