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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>MAC在FPGA中的高效實(shí)現(xiàn)

      MAC在FPGA中的高效實(shí)現(xiàn)

      2010-08-06 | rar | 130 | 次下載 | 5積分

      資料介紹

      乘累加器在DSP算法中有著舉足輕重的地位?，F(xiàn)在，很多前端DSP算法都通過(guò)FPGA實(shí)現(xiàn)。結(jié)合FPGA具體的硬件結(jié)構(gòu)，提出了乘累加器在FPGA中實(shí)現(xiàn)的改進(jìn)方法：流水線技術(shù)、CSD編碼、DA算法，最后給出了這幾種方法的實(shí)驗(yàn)結(jié)果。結(jié)果表明，這些方法的應(yīng)用能大幅度的提高乘累加器在FPGA中的運(yùn)行性能。
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