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提出了一種用FPGA技術(shù)實(shí)現(xiàn)混沌迭代序列的一種新方法，該方法適用于符合二次三
項(xiàng)式牲征的混沌系統(tǒng)。根據(jù)離散化和數(shù)字化處理技術(shù)，對(duì)三維混沌系統(tǒng)作離散化處理，同時(shí)對(duì)實(shí)數(shù)進(jìn)行處理，使離散化后的混沌系統(tǒng)和實(shí)數(shù)處理后的數(shù)據(jù)便于在FPGA中實(shí)現(xiàn)。利用VHDL硬件描述語(yǔ)言編程和FPGA技術(shù)產(chǎn)生三維混沌迭代序列。本文以chen系統(tǒng)為例,闡述這種方法的設(shè)計(jì)流程。基于芯片型號(hào)為EP2C35F672C6的FPGA開發(fā)平臺(tái)，給出FPGA硬件實(shí)現(xiàn)的結(jié)果，并在顯波器上顯示產(chǎn)生的混沌吸引子。
項(xiàng)式牲征的混沌系統(tǒng)。根據(jù)離散化和數(shù)字化處理技術(shù)，對(duì)三維混沌系統(tǒng)作離散化處理，同時(shí)對(duì)實(shí)數(shù)進(jìn)行處理，使離散化后的混沌系統(tǒng)和實(shí)數(shù)處理后的數(shù)據(jù)便于在FPGA中實(shí)現(xiàn)。利用VHDL硬件描述語(yǔ)言編程和FPGA技術(shù)產(chǎn)生三維混沌迭代序列。本文以chen系統(tǒng)為例,闡述這種方法的設(shè)計(jì)流程。基于芯片型號(hào)為EP2C35F672C6的FPGA開發(fā)平臺(tái)，給出FPGA硬件實(shí)現(xiàn)的結(jié)果，并在顯波器上顯示產(chǎn)生的混沌吸引子。
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