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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的串行接收模塊的設(shè)計(jì)

      基于FPGA的串行接收模塊的設(shè)計(jì)

      2009-09-24 | rar | 226 | 次下載 | 3積分

      資料介紹

      為了使計(jì)算機(jī)能夠通過(guò)串口控制FPGA 的輸出信號(hào)，筆者根據(jù)異步串行通信的原理，設(shè)計(jì)了簡(jiǎn)便易行的FPGA 串行通信接口系統(tǒng)，并應(yīng)用VHDL 語(yǔ)言在FPGA 內(nèi)部集成了串行接收模塊，具有較強(qiáng)的通用性和推廣價(jià)值。
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