資料介紹
The \x92FCT573T devices consist of eight latches with 3-state outputs for bus-organized applications. When the latch-enable (LE) input is high, the flip-flops appear transparent to the data. Data that meets the required setup times are latched when LE transitions from high to low. Data appears on the bus when the output-enable (OE\) input is low. When OE\ is high, the bus output is in the high-impedance state. In this mode, data can be entered into the latches. The \x92FCT573T devices are identical to the \x92FCT373T devices, except for the flow-through pinout of the \x92FCT573T, which simplifies board design.
These devices are fully specified for partial-power-down applications using Ioff. The Ioff?circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.
- 54/74FCT573T 數(shù)據(jù)表
- 54/74FCT573T 數(shù)據(jù)表
- CY54FCT138T,CY74FCT138T,pdf(1-
- CY74FCT573AT,pdf(8-Bit Latches
- CY74FCT16841AT,pdf(20-Bit Latc
- CY74FCT16373AT,pdf(16-Bit Latc
- CY74FCT162373AT,pdf(16-Bit Lat
- CY74FCT16374T,CY74FCT162374T,p
- CY74FCT16245T,CY74FCT162245T,C
- CY74FCT16646AT,pdf(16-Bit Regi
- CY74FCT16646T,CY74FCT162646T,p
- CY74FCT16543T,CY74FCT162543T,C
- CY74FCT16827T,CY74FCT162827T,p
- CY74FCT16827T,CY74FCT162827T,p
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