資料介紹
These octal buffers and line drivers are designed specifically to improve both the performance and density of 3-state memory address drivers, clock drivers, and bus-oriented receivers and transmitters. The ’HCT240 devices are organized as two 4-bit buffers/drivers with separate output-enable (OE)\ inputs. When (OE)\ is low, the device passes inverted data from the A inputs to the Y outputs. When (OE)\ is high, the outputs are in the high-impedance state.
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存器SN54HCT646 SN74HCT646數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器SN54HCT623 SN74HCT623數(shù)據(jù)表
- 帶三態(tài)輸出的八進(jìn)制總線收發(fā)器SN54HCT645 SN74HCT645數(shù)據(jù)表
- 帶時鐘使能的八進(jìn)制D型觸發(fā)器SN54HCT377 SN74HCT377 數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制緩沖器和線路驅(qū)動器SN54HCT540 SN74HCT540數(shù)據(jù)表
- 具有三態(tài)輸出的八進(jìn)制總線收發(fā)器和寄存器SN54HCT652 SN74HCT652數(shù)據(jù)表
- 3.3伏ABT八進(jìn)制緩沖器/驅(qū)動器SN54LVTH240 SN74LVTH240 數(shù)據(jù)表
- 3.3伏ABT八進(jìn)制緩沖器/驅(qū)動器SN54LVTH240 SN74LVTH240數(shù)據(jù)表
- HD74HCT240 數(shù)據(jù)表
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