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      電子發(fā)燒友網(wǎng)>電子資料下載>單片機(jī)>cortex m3/m4處理器的復(fù)位設(shè)計(jì)

      cortex m3/m4處理器的復(fù)位設(shè)計(jì)

      2021-12-04 | pdf | 0.14 MB | 次下載 | 2積分

      資料介紹

      cortex m3/m4處理器在復(fù)位層面總體上可以劃分為core和debug logic兩部分。core部分包括處理器內(nèi)核(core)以及NVIC，BUS Matrix，MPU的非debug部分。debug logic部分包括debug模塊(SWD接口，ETM, AHB-AP, TPIU等)以及NVIC，BUS Matrix，MPU的debug部分。下文中，用core代指core部分，debug代指debug部分。除JTAG的reset信號(hào)nTRST外，cortex m3/m4相關(guān)的復(fù)位信號(hào)主要有四個(gè)：
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