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      電子發(fā)燒友網(wǎng)>電子資料下載>單片機(jī)>Xilinx開發(fā)板教程之如何進(jìn)行ISP器件的設(shè)計與應(yīng)用

      Xilinx開發(fā)板教程之如何進(jìn)行ISP器件的設(shè)計與應(yīng)用

      2018-12-03 | rar | 1.09 MB | 次下載 | 免費

      資料介紹

      　　掌握采用可編程邏輯器件實現(xiàn)數(shù)字電路與系統(tǒng)的方法程 ；

      　　掌握采用Xilinx_ISE軟件開發(fā)可編程器件的過程；

      　　掌握Verilog HDL描述數(shù)字邏輯電路與系統(tǒng)的方法；

      　　掌握分層次、分模塊的電路設(shè)計方法，熟悉使用可編程器件實現(xiàn)數(shù)字系統(tǒng)的一般步驟。

      　　Xilinx_ISE軟件使用與Digilentt Basys2實驗系統(tǒng)介紹

      　　使用verilog語言設(shè)計實現(xiàn)---流水燈實驗（舉例）

      　　使用verilog語言設(shè)計實現(xiàn)---模六十計數(shù)器

      　　功能要求：

      　　利用實驗板實現(xiàn)模六十計數(shù)，即0-1-2-3-4-…59-0-1…，并在Basys2實驗板的AN0與（LD3~LD0）上顯示。

      　　設(shè)計步驟與要求：

      　　1） 計算并說明采用Basys2實驗板時鐘50MHz實現(xiàn)系統(tǒng)功能的基本原理。

      　　2） 在Xilinx ISE13.1 軟件中，編寫輸入所設(shè)計的源程序文件。

      　　3） 對源程序進(jìn)行編譯及仿真分析（注意合理設(shè)置，以便能夠在驗證邏輯的基礎(chǔ)上盡快得出仿真結(jié)果）。

      　　4） 輸入管腳約束文件，對設(shè)計項目進(jìn)行編譯與邏輯綜合，生成下載所需.bit類型文件。

      　　5） 在Basys2實驗板上下載所生成的.bit文件，觀察驗證所設(shè)計的電路功能。

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