如何通過3個(gè)方面來提高ADC優(yōu)化時(shí)鐘信號(hào)的轉(zhuǎn)換速率概述
資料介紹
新的高速ADC配備了一個(gè)大的模擬輸入帶寬(約三至六倍的最大采樣頻率),因此它們可以用于欠采樣應(yīng)用。ADC設(shè)計(jì)的最新進(jìn)展顯著地?cái)U(kuò)展了可用的輸入范圍,使得系統(tǒng)設(shè)計(jì)者可以消除至少一個(gè)中頻級(jí),這降低了成本和功耗。在欠采樣接收機(jī)的設(shè)計(jì)中,必須特別注意采樣時(shí)鐘,因?yàn)樵谳^高的輸入頻率下,時(shí)鐘的抖動(dòng)成為限制信噪比(SNR)的主導(dǎo)因素。
這三部分文章系列的第1部分著重于如何準(zhǔn)確地估計(jì)時(shí)鐘源的抖動(dòng),并將其與ADC的孔徑抖動(dòng)相結(jié)合。在第2部分中,該組合抖動(dòng)將用于計(jì)算ADC的SNR,然后將其與實(shí)際測量進(jìn)行比較。第3部分將展示如何通過改善ADC的孔徑抖動(dòng)來進(jìn)一步提高ADC的SNR,重點(diǎn)是優(yōu)化時(shí)鐘信號(hào)的轉(zhuǎn)換速率。
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