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RS總線集成電路在航空航天及工業(yè)控制領(lǐng)域具有廣泛的應(yīng)用，隨著集成電路硬件木馬的檢測(cè)成為研究熱點(diǎn)，作為總線硬件木馬研究領(lǐng)域的分支，其設(shè)計(jì)越來越受關(guān)注。在常規(guī)時(shí)序型硬件木馬的基礎(chǔ)上，針對(duì)RS232總線集成電路，設(shè)計(jì)一種基于可逆計(jì)數(shù)器的時(shí)序型總線硬件木馬。采用Xiix公司的ISE軟件在RTL層設(shè)計(jì)相應(yīng)的RS232總線 Verilog代碼，并在常規(guī)和可逆時(shí)序型硬件木馬觸發(fā)閾值呈等差遞增的條件下進(jìn)行 Modelsim仿真分析結(jié)果表明，在總線功能需求復(fù)雜和傳輸數(shù)據(jù)較多的情況下，可逆時(shí)序型木馬比常規(guī)時(shí)序型硬件木馬具有靈活性和較低的觸發(fā)率，隱蔽性更強(qiáng)。
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