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      電子發(fā)燒友網(wǎng)>電子資料下載>規(guī)則標(biāo)準(zhǔn)>Verilog代碼書寫規(guī)范

      Verilog代碼書寫規(guī)范

      2010-04-15 | rar | 210 | 次下載 | 10積分

      資料介紹

      Verilog代碼書寫規(guī)范

      本規(guī)范的目的是提高書寫代碼的可讀性、可修改性、可重用性，優(yōu)化代碼綜合和仿真的結(jié)果，指導(dǎo)設(shè)計(jì)工程師使用VerilogHDL規(guī)范代碼和優(yōu)化電路，規(guī)范化可編程技術(shù)部的FPGA設(shè)計(jì)輸入，從而做到：① 邏輯功能正確，②可快速仿真，③ 綜合結(jié)果最優(yōu)（如果是hardware model)，④可讀性較好。

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